Nexperia 74HC165D,653 8-stage Surface Mount Shift Register 74HC, 16-Pin SOIC

ยอดรวมย่อย (1 รีล รีลละ 2500 ชิ้น)*

THB11,767.50

(ไม่รวมภาษีมูลค่าเพิ่ม)

THB12,590.00

(รวมภาษีมูลค่าเพิ่ม)

Add to Basket
เลือกหรือพิมพ์จำนวน
หมดสต็อกชั่วคราว
  • 12,500 ชิ้นจะส่งได้หลังจากวันที่ 27 พฤษภาคม 2569 ไปอีกประมาณ 7 วันทำการ
ต้องการสินค้าเพิ่มหรือไม่ ระบุจำนวนและคลิก ‘ตรวจสอบวันจัดส่ง’ เพื่อดูข้อมูลเพิ่มเติมเกี่ยวกับสต็อกสินค้าและการจัดส่ง
ชิ้น
ต่อหน่วย
ต่อม้วน*
2500 +THB4.707THB11,767.50

*ตัวบ่งบอกราคา / price indicative

RS Stock No.:
170-7987
หมายเลขชิ้นส่วนของผู้ผลิต / Mfr. Part No.:
74HC165D,653
ผู้ผลิต:
Nexperia
ค้นหาผลิตภัณฑ์ที่คล้ายกันโดยเลือกคุณลักษณะอย่างน้อยหนึ่งรายการ
เลือกทั้งหมด

Brand

Nexperia

Package Type

SO

Logic Function

Shift Register

Number of Stages

8

Logic Family

74HC

Mounting Type

Surface Mount

Operation Mode

Serial, Parallel to Serial

Number of Elements

1

Pin Count

16

Minimum Operating Supply Voltage

2 V

Maximum Operating Supply Voltage

6 V

Dimensions

10 x 4 x 1.45mm

Minimum Operating Temperature

-40 °C

Direction Type

Uni-Directional

Triggering Type

Positive Edge

Preset Type

Asynchronous, Synchronous

Maximum Operating Temperature

125 °C

74HC Family Counters & Shift Registers, Nexperia


A range of 74HC Family CMOS Logic Counters and Shift Registers from NXP. The 74HC Family use silicon gate CMOS technology to achieve operating speeds similar to the LSTTL family but with the low power consumption of standard CMOS integrated circuits.

High-Speed CMOS Logic
Operating Voltage: 2 to 6 V
Compatibility: Input CMOS, Output CMOS

The 74HC165, 74HCT165 are high-speed Si-gate CMOS devices. They are pin compatible with Low-power Schottky TTL (LSTTL). The 74HC165, 74HCT165 are 8-bit parallel-load or serial-in shift registers with complementary serial outputs (Q7 and Q7) available from the last stage. When the parallel load (PL) input is LOW, parallel data from the D0 to D7 inputs are loaded into the register asynchronously. When PL is HIGH, data enters the register serially at the DS input and shifts one place to the right (Q0 → Q1 → Q2, etc.) with each positive-going clock transition. This feature allows parallel-to-serial converter expansion by tying the Q7 output to the DS input of the succeeding stage. The clock input is a gated-OR structure which allows one input to be used as an active LOW clock enable (CE) input.

Simple control interface
I/O expansion
Asynchronous and synchronous load options
High frequency
Cascadable
LED drivers
Key applications
Displays
Control units

For these non-cancellable (NC), and non-returnable (NR) products, Terms and Conditions apply.



74HC Family

ลิงก์ที่เกี่ยวข้อง